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BU97501KV 데이터시트 PDF




ROHM Semiconductor에서 제조한 전자 부품 BU97501KV은 전자 산업 및 응용 분야에서
광범위하게 사용되는 반도체 소자입니다.


 

PDF 형식의 BU97501KV 자료 제공

부품번호 BU97501KV 기능
기능 Multifunction LCD Segment Driver
제조업체 ROHM Semiconductor
로고 ROHM Semiconductor 로고


BU97501KV 데이터시트 를 다운로드하여 반도체의 전기적 특성과 매개변수에 대해 알아보세요.




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BU97501KV 데이터시트, 핀배열, 회로
Datasheet
Multifunction LCD Segment Driver
BU97501KV MAX 204 segments (51SEG×4COM)
Features
Key input function for up to 30 keys (A key scan is
performed only when a key is pressed.)
Either 1/4 or 1/3 duty can be selected
1/4 duty driveUp to 204 segments
1/3 duty driveUp to 156 segments
Integrated RAM for display data (DDRAM)
Segment/GPO (Max 4port) output mode selectable
Support standby mode
Integrated Power-on Reset circuit
Integrated Oscillator circuit
No external component
Low power consumption design
Applications
Telephone
FAX
Portable equipment (POS, ECR, PDA etc.)
DSC
DVC
Car audio
Home electrical appliance
Meter equipment
Key Specifications
Supply Voltage Range:
2.7V to 6.0V
LCD drive power supply Range:
4.5V to 6.0V
Operating Temperature Range: -40°C to +85°C
Max Segments:
204 Segments
Display Duty:
1/3, 1/4 selectable
Bias:
1/2, 1/3 selectable
Interface:
3wire serial interface
Package
VQFP64
W(Typ.)×D(Typ.)×H(Max.)
VQFP64
12.00mm x 12.00mm x 1.60mm
Typical Application Circuit
KMeyatMrixatrix
+5V
(Note1)
+5.5V
(Note1)
From
Controller
To Controller
KS1/S42
|
KS6/S47
VDD
KI1/S48
|
KI5/S52
COM1
COM2
COM3
P1/S1
P2/S2
VLCD
OSC
RESB
CSB
SCL
SD
DO
P4/S4
S5
S40
COM4/S41
(P1)
(P2) (General purpose ports)
(For use control of backlight)
(P4)
LCD Panel
(Up to 204
Segments)
(Note1) Insert capacitors between VDD/VLCD and VSS C0.1uF.
Figure 1. Typical Application Circuit
Product structureSilicon monolithic integrated circuit
www.rohm.com
© 2013 ROHM Co., Ltd. All rights reserved.
TSZ2211114001
This product is not designed for protection against radioactive rays.
1/30
TSZ02201-0P4P0D300390-1-2
11.Apr.2014 Rev.004




BU97501KV pdf, 반도체, 판매, 대치품
BU97501KV
Datasheet
Electrical Characteristics – continued
Oscillation Characteristics (Ta=-40°C to +85°C, VDD=2.7 to 6.0V, VLCD=4.5V to 6.0V, VSS=0.0V)
Parameters
Symbol
MIN
Limits
TYP
MAX
Unit
Conditions
Frame Frequency1
fFR1
56
80 104 Hz VLCD=4.5V to 6.0V, fFR = 80Hz setting
Frame Frequency2
fFR2
68
80
92 Hz VLCD=5.0V, fFR = 80Hz setting
External Clock Frequency fFR3
30
-
600
kHz
External clock mode
(DRV CTRL1 setting : P2P1=11)
Frame frequency is decided external frequency and dividing ratio of DRV CTRL1 setting.
Reference Data
100
VDD = 4.0V Setting
90 VLCD = 6.0V
VLCD = 5.0V
80
VLCD = 4.5V
70
60
-40 -20 0 20 40 60 80
Temperature[]
Figure 4. Typical temperature characteristics
MPU interface Characteristics (Ta=-40 to +85°C, VDD=2.7V to 6.0V, VLCD=4.5 to 6.0V, VSS=0.0V)
Parameters
Limits
Symbol
Unit
MIN TYP MAX
Conditions
Input Rise Time
tr - - 80 ns
Input Fall Time
tf - - 80 ns
SCL Cycle Time
tSCYC 400
-
- ns
“H” SCL Pulse Width
tSHW
100
-
- ns
“L” SCL Pulse Width
tSLW
100
-
- ns
SD Setup Time
tSDS
20
-
- ns
SD Hold Time
tSDH
20
-
- ns
CSB Setup Time
tCSS
50
-
- ns
CSB Hold Time
tCSH
50
-
- ns
“H” CSB Pulse Width
tCHW
50
-
- ns
DO Output Delay Time
tDC -
- 1.5 µs DO RPU=4.7k, CL=10pF (Note4)
DO Rise Time
tDR -
- 1.5 µs DO RPU=4.7k, CL=10pF (Note4)
(Note4) Since DO can be an open-drain output; these values depend on the resistance of the pull-up resistor RPU and the load capacitance CL.
tCHW
CSB
SCL
tCSS
tf
tSLW
tSCYC
tSHW
tr
tCSH
tSDS tSDH
SD
DO
www.rohm.com
© 2013 ROHM Co., Ltd. All rights reserved.
TSZ2211115001
tDC
Figure 5. 3-wire Serial Interface Timing
4/30
tDR
TSZ02201-0P4P0D300390-1-2
11.Apr.2014 Rev.004

4페이지










BU97501KV 전자부품, 판매, 대치품
BU97501KV
Datasheet
1/3 Duty Mode
DDRAM Address/Segment Outputs
00h 01h 02h ... 27h 28h 29h ... 31h 32h 33h
0 D1 D4 D7
D118 D121 D124
D148 D151 D154 COM1
BIT 1 D2 D5 D8
D119 D122 D125
D149 D152 D155 COM2
2 D3 D6 D9
D120 D123 D126
D150 D153 D156 COM3
S1 S2 S3
S40 S41 S42
S50 S51 S52
Transferred data is written to the DDRAM by every 3bits. The write operation is cancelled if it changes CSB=”L””H”
before 3bits data transfer.
1/4 Duty Mode
DDRAM Address/ Segment Outputs
00h 01h 02h ... 27h 28h 29h ... 30h 31h 32h
0 D1 D5 D9
D157 D161 D165
D193 D197 D201 COM1
1
BIT
2
D2
D3
D6 D10
D7 D11
D158 D162 D166
D159 D163 D167
D194 D198 D202 COM2
D195 D199 D203 COM3
3 D4 D8 D12
D160 D164 D168
D196 D200 D204 COM4
S1 S2 S3
S40 S42 S43
S50 S51 S52
Transferred Data is written to the DDRAM by every 4bits. The write operation is cancelled if it changes CSB=”L””H”
before 4bits data transfer.
Relationship between Display Data and Segment Output Pins
1/3 Duty Mode
output
terminal
COM1
COM2
COM3 Address
output
terminal
COM1
COM2
S1/P1
D1
D2
D3
00
S27 D79 D80
S2/P2
D4
D5
D6
01
S28 D82 D83
S3/P3
D7
D8
D9
02
S29 D85 D86
S4/P4
D10
D11
D12
03
S30 D88 D89
S5 D13 D14 D15 04
S31 D91 D92
S6 D16 D17 D18 05
S32 D94 D95
S7 D19 D20 D21 06
S33 D97 D98
S8 D22 D23 D24 07
S34
D100
D101
S9 D25 D26 D27 08
S35
D103
D104
S10 D28 D29 D30 09
S36
D106
D107
S11 D31 D32 D33 0A
S37
D109
D110
S12 D34 D35 D36 0B
S38
D112
D113
S13 D37 D38 D39 0C
S39
D115
D116
S14 D40 D41 D42 0D
S40
D118
D119
S15
D43 D44 D45
0E
COM4/S41 D121
D122
S16 D46 D47 D48 0F
KS1/S42 D124
D125
S17 D49 D50 D51 10
KS2/S43 D127
D128
S18 D52 D53 D54 11
KS3/S44 D130
D131
S19 D55 D56 D57 12
KS4/S45 D133
D134
S20 D58 D59 D60 13
KS5/S46 D136
D137
S21 D61 D62 D63 14
KS6/S47 D139
D140
S22 D64 D65 D66 15
KI1/S48 D142
D143
S23 D67 D68 D69 16
KI2/S49 D145
D146
S24 D70 D71 D72 17
KI3/S50 D148
D149
S25 D73 D74 D75 18
KI4/S51 D151
D152
S26 D76 D77 D78 19
KI5/S52 D154
D155
(Note5) In case of S1/P1~S4/P4, COM4/S41, KS1/S42~KS6/S47 and KI1/S48~KI5/S52 are selected for segment output.
COM3
D81
D84
D87
D90
D93
D96
D99
D102
D105
D108
D111
D114
D117
D120
D123
D126
D129
D132
D135
D138
D141
D144
D147
D150
D153
D156
address
1A
1B
1C
1D
1E
1F
20
21
22
23
24
25
26
27
28
29
2A
2B
2C
2D
2E
2F
30
31
32
33
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