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3D7501D 데이터시트 PDF




ETC에서 제조한 전자 부품 3D7501D은 전자 산업 및 응용 분야에서
광범위하게 사용되는 반도체 소자입니다.


PDF 형식의 3D7501D 자료 제공

부품번호 3D7501D 기능
기능 MONOLITHIC MANCHESTER ENCODER
제조업체 ETC
로고 ETC 로고


3D7501D 데이터시트 를 다운로드하여 반도체의 전기적 특성과 매개변수에 대해 알아보세요.



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3D7501D 데이터시트, 핀배열, 회로
MONOLITHIC MANCHESTER
ENCODER
(SERIES 3D7501)
3D7501
data
delay
3
®
devices, inc.
FEATURES
All-silicon, low-power CMOS
technology
TTL/CMOS compatible inputs and
outputs
Vapor phase, IR and wave
solderable
Auto-insertable (DIP pkg.)
Low ground bounce noise
Maximum data rate: 50 MBaud
PACKAGES
CLK
RESB
DAT
GND
1
2
3
4
8 VDD
7 N/C
6 TXB
5 TX
3D7501M DIP (.300)
3D7501H Gull Wing (.300)
3D7501Z SOIC (.150)
CLK 1 14 VDD
N/C 2 13 N/C
N/C 3 12 N/C
RESB 4 11 N/C
DAT 5 10 N/C
N/C 6 9 TXB
GND 7 8 TX
3D7501 DIP (.300)
3D7501G Gull Wing (.300)
3D7501D SOIC (.150)
FUNCTIONAL DESCRIPTION
PIN DESCRIPTIONS
The 3D7501 is a monolithic CMOS Manchester Encoder. The clock
and data, present at the unit input, are combined into a single bi-
phase-level signal. In this encoding mode, a logic one is represented
by a high-to-low transition within the bit cell, while a logic zero is
represented by a low-to-high transition. The unit operating baud rate (in
Mbaud) is equal to the input clock frequency (in MHZ) . All pins
marked N/C must be left unconnected.
DAT Data Input
CLK Clock Input
RESB Reset
TX Signal Output
TXB Inverted Signal Output
VCC +5 Volts
GND Ground
The all-CMOS 3D7501 integrated circuit has been designed as a reliable, economic alternative to hybrid
TTL Manchester Encoder. It is TTL- and CMOS-compatible, capable of driving ten 74LS-type loads. It is
offered in standard 8-pin and 14-pin auto-insertable DIPs and space saving surface mount 8-pin and 14-
pin SOICs.
Doc #96010
5/19/97
DATA DELAY DEVICES, INC.
3 Mt. Prospect Ave. Clifton, NJ 07013
1




3D7501D pdf, 반도체, 판매, 대치품
3D7501
SILICON DELAY LINE AUTOMATED TESTING
TEST CONDITIONS
INPUT:
Ambient Temperature: 25oC ± 3oC
Supply Voltage (Vcc): 5.0V ± 0.1V
Input Pulse:
High = 3.0V ± 0.1V
Low = 0.0V ± 0.1V
Source Impedance: 50Max.
Rise/Fall Time:
3.0 ns Max. (measured
between 0.6V and 2.4V )
Pulse Width:
PWIN = 1/(2*BAUD)
Period:
PERIN = 1/BAUD
OUTPUT:
Rload:
Cload:
Threshold:
10KΩ ± 10%
5pf ± 10%
1.5V (Rising & Falling)
Device
Under
Test
10K
470
Digital
Scope
5pf
NOTE: The above conditions are for test only and do not in any way restrict the operation of the device.
COMPUTER
SYSTEM
PRINTER
WAVEFORM
GENERATOR
OUT
TRIG
IN DEVICE UNDER OUT IN
TEST (DUT)
TRIG
DIGITAL SCOPE
Figure 2: Test Setup
INPUT
SIGNAL
OUTPUT
SIGNAL
tRISE
PWIN
PERIN
tFALL
2.4V VIH 2.4V
1.5V
1.5V
0.6V
0.6V
VIL
tPLH
tPHL
1.5V
VOH
1.5V
Figure 3: Timing Diagram
VOL
Doc #96010
DATA DELAY DEVICES, INC.
5/19/97
Tel: 973-773-2299 Fax: 973-773-9672 http://www.datadelay.com
4

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