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7LVC573APWDH 데이터시트 PDF




NXP Semiconductors에서 제조한 전자 부품 7LVC573APWDH은 전자 산업 및 응용 분야에서
광범위하게 사용되는 반도체 소자입니다.


PDF 형식의 7LVC573APWDH 자료 제공

부품번호 7LVC573APWDH 기능
기능 Octal D-type transparent latch with 5-volt tolerant inputs/outputs 3-State
제조업체 NXP Semiconductors
로고 NXP Semiconductors 로고


7LVC573APWDH 데이터시트 를 다운로드하여 반도체의 전기적 특성과 매개변수에 대해 알아보세요.



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7LVC573APWDH 데이터시트, 핀배열, 회로
INTEGRATED CIRCUITS
74LVC573A
Octal D-type transparent latch with 5-volt
tolerant inputs/outputs (3-State)
Product specification
1998 Jul 29
Philips
Semiconductors




7LVC573APWDH pdf, 반도체, 판매, 대치품
Philips Semiconductors
Octal D-type transparent latch with 5-volt
tolerant inputs/outputs (3-State)
Product specification
74LVC573A
LOGIC DIAGRAM
D0 D1 D2 D3 D4 D5 D6 D7
DQ
LATCH
1
LE LE
DQ
LATCH
2
LE LE
DQ
LATCH
3
LE LE
DQ
LATCH
4
LE LE
DQ
LATCH
5
LE LE
DQ
LATCH
6
LE LE
DQ
LATCH
7
LE LE
DQ
LATCH
8
LE LE
LE
OE
Q0 Q1 Q2 Q3 Q4 Q5
FUNCTION TABLE
OPERATING MODES
Enable and read register
(transparent mode)
INPUTS
OE LE Dn
LHL
L HH
Latch and read register
L
L
l
LLh
Latch register and
disable outputs
HL
l
HL h
H = HIGH voltage level
h = HIGH voltage level one setup time prior to the HIGH-to-LOW LE transition
L = LOW voltage level
l = LOW voltage level one setup time prior to the HIGH-to-LOW LE transition
X = Don’t care
Z = High impedance OFF-state
INTERNAL LATCHES
L
H
L
H
L
H
Q6 Q7
SA00399
OUTPUTS
Q0 to Q7
L
H
L
H
Z
Z
1998 Jul 29
4

4페이지










7LVC573APWDH 전자부품, 판매, 대치품
Philips Semiconductors
Octal D-type transparent latch with 5-volt
tolerant inputs/outputs (3-State)
Product specification
74LVC573A
AC WAVEFORMS
VM = 1.5V at VCC w 2.7V; VM = 0.5 VCC at VCC t 2.7V.
VOL and VOH are the typical output voltage drop that occur with the
output load.
VX = VOL + 0.3V at VCC w 2.7V; VX = VOL + 0.1 VCC at VCC t 2.7V
VY = VOH –0.3V at VCC w 2.7V; VY = VOH – 0.1 VCC at VCC t 2.7V
VI
INPUT
VM
GND
VOH
tPHL
tPLH
OUTPUT
VM
VOL
SY00041
Waveform 1. Input (Dn) to output (Qn) propagation delays.
VI
LE INPUT
GND
VOH
Qn OUTPUT
VOL
VM
tw
tPHL
VM
tPLH
SA00388
Waveform 2. Latch enable input (LE) pulse width, the latch
enable input to output (Qn) propagation delays
VI
nOE INPUT
GND
VM
VCC
Qn OUTPUT
LOW-to-OFF
OFF-to-LOW
VOL
VOH
Qn OUTPUT
HIGH-to-OFF
OFF-to-HIGH
GND
tPLZ
tPZL
VX
tPHZ
VY
tPZH
outputs
enabled
outputs
disabled
Waveform 3. 3-State enable and disable times.
VM
VM
outputs
enabled
SW00207
VI
ÉÉÉDn
INPUT
ÉÉÉÉÉÉGND
VM
ÉÉÉtÉÉÉh ÉÉÉÉÉÉÉÉÉÉÉÉÉÉÉÉÉÉth ÉÉÉÉÉÉ
tSU
VI
tSU
LE
INPUT
VM
GND
NOTE: The shaded areas indicate when the input is permitted to change
for predictable output performance.
SW00073
Waveform 4. Data setup and hold times for the Dn input to the
LE input.
TEST CIRCUIT
VCC
PULSE
GENERATOR
VIN
RT
D.U.T.
VOUT
CL
S1
2<VCC
Open
GND
RL=500
RL=500
Test Circuit for 3-State Outputs
SWITCH POSITION
TEST
tPLH/tPHL
tPLZ/tPZL
tPHZ/tPZH
SWITCH
Open
2<VCC
GND
VCC
t 2.7V
2.7 – 3.6V
VIN
VCC
2.7V
DEFINITIONS
RL = Load resistor
CL = Load capacitance includes jig and probe capacitance
RT = Termination resistance should be equal to ZOUT
of pulse generators.
SW00047
Waveform 5. Load circuitry for switching times.
1998 Jul 29
7

7페이지


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