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BU1924F 데이터시트 PDF




ROHM Semiconductor에서 제조한 전자 부품 BU1924F은 전자 산업 및 응용 분야에서
광범위하게 사용되는 반도체 소자입니다.


 

PDF 형식의 BU1924F 자료 제공

부품번호 BU1924F 기능
기능 RDS / RBDS decoder
제조업체 ROHM Semiconductor
로고 ROHM Semiconductor 로고


BU1924F 데이터시트 를 다운로드하여 반도체의 전기적 특성과 매개변수에 대해 알아보세요.




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BU1924F 데이터시트, 핀배열, 회로
U.comAudio ICs
BU1924 / BU1924F / BU1924FS
RDataSSh/ eRetB4DS decoderBU1924 / BU1924F / BU1924FS
w.DThe BU1924, BU1924F and BU1924FS are RDS / RBDS decoders that employ a digital PLL and have a built-in
ww anti-aliasing filter and an eight-stage BPF (switched-capacitor filter). Linear CMOS circuitry is used for low power
consumption.
mzApplications
RDS / RBDS compatible FM receivers for American and European markets, car stereos, high-fidelity stereo systems and
ocomponents, and FM pagers.
.czFeatures
U1) Low current.
2) Two-stage anti-aliasing filter (LPF).
t43) 57kHz band-pass filter.
4) DSB demodulation (digital PLL).
e5) Quality indication output for demodulated data.
hezAbsolute maximum ratings (Ta = 25°C)
Parameter
Symbol
Limits
SPower supply voltage
taMaximum input voltage
Maximum output voltage
aPower dissipation
VDD
VMax.
IMax.
Pd
0.3~+7.0
0.3~VDD+0.3
±4.0
10001(BU1924)
3002(BU1924F)
5003(BU1924FS)
.DOperating temperature
Topr
40~+85
Storage temperature
Tstg
55~+125
w1 Reduced by 10.0mW for each increase in Ta of 1°C over 25°C.(BU1924)
2 Reduced by 3.0mW for each increase in Ta of 1°C over 25°C.(BU1924F)
3 Reduced by 5.0mW for each increase in Ta of 1°C over 25°C.(BU1924FS)
Unit Conditions
V VDD1 VDD2
V All input pins
mA All output pins
mW
°C
°C
wwzRecommended operating conditions (Ta = 25°C)
mParameter
.coPower supply voltage
Symbol
VDD1
VDD2
Min.
2.7
2.7
Typ.
Max.
5.5
5.5
Unit
V
V
www.DataSheet4U1/5




BU1924F pdf, 반도체, 판매, 대치품
Audio ICs
BU1924 / BU1924F / BU1924FS
zElectrical characteristics (unless otherwise noted, Ta = 25°C, VDD1 = VDD2 = 5.0V, VSS1 =VSS2 = VSS3 = 0.0V)
Parameter
Symbol Min. Typ. Max. Unit
Conditions
Operating current
IDD 6.5 10.0 mA IDD1+IDD2
Reference voltage
Input current 1
Output current 1
Input current 2
Output current 2
Vref
IIN1
IOUT1
IIN2
IOUT2
1/2VDD1
− − 1.0
− − 1.0
0.5
0.5
V Pin 3
µA MUX
µA MUX
µA XI
µA XI
VIN=VDD1
VIN=VSS1
XI=VDD2
XI=VSS2
Output high level voltage 1
Output low level voltage 1
Filter block
VOH1
VOL1
VDD2
1.0
VDD2
0.3
0.2
1.0
V RCLK RDATA QUAL IO=−1.0mA
V RCLK RDATA QUAL IO=1.0mA
Center frequency
FC 56.5 57.0 57.5 kHz
Gain
Attenuation 1
Attenuation 2
Attenuation 3
S / N ratio
GA 20 23 26 dB F=57.0kHz
ATT1 18 22 dB 57kHz±4kHz
ATT2 65 80 dB 38kHz
ATT3 35 50 dB 67kHz
SN 35 dB 57kHz VIN=3.0mVrms
Demodulator
RDS detector sensitivity
SRDS
0.5 1.0 mVrms
RDS input level
VRDS
1.0
300 mVrms
Data rate
DRATE
1187.5
Hz
Clock transient vs. data
CT
Not designed for radiation resistance.
4.3 − µs
zOutput data timing
RCLK
RDATA
T1
T5 T1
T3
T4
T2
T1=T2=4.3µS
T3=T4=421µS
T5=T6=416.7µS
T6 T2
The clock (RCLK) frequency is 1187.5Hz. Depending on the state of the internal PLL clock, the data (RDATA) is replaced
in synchronous with either the rising or falling or falling edge of the clock. To read the data, you may choose either the
rising or falling edge of the clock as the reference. The data is valid for 416.7µs. after the reference clock edge.
QUAL pin operation : Indicates the quality of the demodulated data.
(1) Good data : HI
(2) Poor data : LO
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