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UM6104 PDF 데이터시트 : 부품 기능 및 핀배열

부품번호 UM6104
기능 1K x 4 CMOS SRAM
제조업체 UMC
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UM6104 데이터시트, 핀배열, 회로
(l)UMC
============ UM6104
1K x 4 CMOS SRAM
Features
• Single + 5V power supply
• Low power standby
• Low power operation
• Fast Access time ........ , 120/150/200/250 ns max.
• Data retention . . . . . . . . . . . . . . . . . . .. 2.0V min.
• Three-state outputs
• On-chip address register
• Synchronous circuitry
• Standard 18 pin DIP package
• TTL compatible input/output
General Description
The UM6104 is a 1024x4 fu IIy stat ic CMOS. RAM. The
device utilizes synchronous circuitry to achieve perform-
ance and low power operation.
Pin Configuration
Block Diagram
On chip latches are provided for the addresses allowing
efficient interfacing with microprocessor systems. The data
output can be forced to a high impedance state for use in
expanded memory systems.
LATCHED
ADDRESS
REGISTER
ROW
DECODER
MEMORY
MATRIX
64x64
VCC
GND
1/01 0--+----1:::::1_------1
1/02 o--H.....--I..::::I~ . - - - - - - 1
1/03 0-+-+_1>----' I--Il;:::::'::":':';:~
I/04 o--t-I-+1~-----'
WE 0----1
LATCHED
ADDRESS
REGISTER
2-18




UM6104 pdf, 반도체, 판매, 대치품
A. C. Test Conditions
Input pulse levels: 0.6V to 2.4V
Input pulse rise & fall times (TR & TF ): 10 ns
Timing measurement levels: input: VIL = O.BV
output: VOL = 0.6V
output load: 1 TT L GATE and CL = 100pF
V IH = 2.2V
VO H = 2.4V
Read Cycle Timing Diagram
UM61 04
CE
tRS
WE
I/O
(OUT)
I/O
(IN)
HIGH-Z
HIGH-Z
Write Cycle Timing Diagram
A
CE
WE
I/O
(IN)
I/O,
(OUT)
t AS tAH
tws
HIGH-Z
VALID
tc
tCE
tWD
-11. DH
tDS
VALID
2-21

4페이지













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